在S3C2410A上实现MDB／ICP协议

2．1 S3C2410A芯片UART串行位格式
通过对S3C2410A数据手册的研读，会发现当前一些主流的处理器芯片，比如S3C2410A，UART模块不像传统的51单片机一样正好满足MDB协议的串行位协议格式，S3C2410A的UART数据格式：最高115 200 bps、1个起始位、5～8位数据、1个奇偶校验位(odd／even parity bit)、1或2个停止位。
2．2 S3C2410A支持MDB／ICP应用方法
如果要想支持MDB协议，S3C2410A没有mode bit可用，这样对MDB总线上的数据判断是地址字节还是数据字节和总线一帧数据什么时候结束在S3C2410A上无法判断识别，这对最初制定的方案提出了严重的挑战，迫不得已要对S3C2410A成为MDB／IPC协议的VMC设备的可能性进行预研，最直接的方式就是想到利用S3C2410A的可选的奇偶校验位的值来逆推MDB设备的mode bit的值，让奇偶校验位来充当MDB mode bit的作用，从而来判断出S3C2410A接收MDB设备传送的数据是否是结束了。经过分析就可以得到表1所列的推理。

通过上面的分析，开始编写测试程序，结果发现S3C2410A的串口设计的一个bug：当配置UART LINECONTROL REG ULCONn的BITS[5：3]为“101”，选择evenparity接收MDB总线的数据的时候，无论是构造出来的数据1的位数为奇数个还是偶数个搭配具体的模式位，发现S3C2410A的UART ERRORSTATUS REG(UERSTATn)的bit2 frame error位并不能准确的置位。想想S3C2410A这么流行的芯片竟然还有设计不完美的地方，几乎要放弃的时候，本着一切皆有可能的原则，既然芯片都不可靠了，就索性测试一下，按照表1把ULCONn的BITS[5：3]设置为“100”，选择odd parity接收数据。按常理推断even parity的结果应该和odd parity结果是一样的，抱着试一试的态度，构造测试代码，结果出现了明显的规律：当模式位为“O”的时候，UERSTATn的bit2 frame error位可以准确的置位；当模式位为“1”的时候，UART TX／RX STATUS REG(UTRSTATn)的bit 0(receive buffer data ready)可以准确置位，正常接收数据。得到这个规律之后，2410 VMC设备就可以准确判断出MDB设备发送过来的数据是否是收到了结束标志。另外，当VMC向MDB设备发送数据的时候，可以按照协议要求当要发送地址字节时可设置ULCONn的BITS[5：3]为“110”，代表parity forced／checked as 1来把奇偶位强制1充当模式位，地址字节发送结束之后调整ULCONn的BITS[5：3]为“111”来发送数据字节。至此，S3C2410A充当MDB VMC设备可以得到完美的解决。下面是VMC接收总线数据的部分调试代码片段。VMC向总线发送数据相对比较简单，有兴趣的读者可以与笔者交流探讨。