基于FPGA的PCIE总线扩展卡的设计

　　图1是用SignalTap工具获取的链式DMA读时序图。PCIE核接收tx_req0请求信号，然后给出一个tx_ack0，同时将tx_dr0置为有效，该信号套住的TXData就是需要读取的有效数据。在每次DMA结束之后，PCIE核都会用同样的控制逻辑给主机传送1个已完成DMA次数的状态字，如图1中的44040000h。

4 性能测试

　　在做总线性能测试时，采用链式DMA传输方式，共4个描述符表。根据实际使用的PCIE总线通道数和DMA长度的不同，实际测试得到的总线速度也不同，表3给出了参考数据。

5 结语

　　使用FPGA来设计PCIE总线扩展卡，可以省去专用的PCIE接口芯片，降低了硬件设计成本，提高了硬件的集成度。利用FPGA的可编程特性，大大提高了设计灵活性、适应性和可扩展性。PCIE总线提供了高速、独享的数据交换通道，确保在大数据量的数据交换时不会出现瓶颈，而且作为新一代总线，它使系统在获得更高性能的同时，具有了良好的升级性。