基于FPGA-SPARTAN芯片的CCD的硬件驱动电路设计
在感光阶段即A的上升沿阶段，P1，P2，P3，P4保持不变，感光阵列和帧存储区之间为阻断态，两者之间不会发生电荷转移现象。但感光阵列接受外界光源照射会积累电荷，在电荷积累的同时，在读出寄存器时钟L1，2的控制下，会首先读出一行电荷。当读完第1行信号之后，会进行1次行转移。在寄存器时钟的控制下，寄存器时钟M1中的信号会转移给寄存器M2，然后再次转移到寄存器M3，M4。行转移时，读出寄存器时钟L1，L2不变，无像元信号输出。在行转移结束之后，进行第2行电荷的读出;每读出1行信号，进行1次行转移，如图3所示，如此循环1056次则感光阶段完成。转移阶段即为门控时钟A的下降沿阶段，如图4所示。帧转移控制信号P1，P2，P3，P4与行转移控制信号M1，M2，M3，M4相同，且一直有效。读出寄存器时钟L1，L2无效，不输出数据。在帧转移结束之后，进入感光阶段，存储区首先进行1次行转移，开始信号的输出，同时感光区像元进入电荷积累。这样就构成了TH7888A工作的1个周期。
主时钟脉冲周期定为50 ns，然后主时钟通过4分频产生L和R。L作为基础波形会在以后产生和控制L1，L2和M类波形时使用，L的占空比为2：2，R的占空比为3：1。给L建一个循环记数器CL，它的范围为0～1 065，在感光阶段即A的上升沿阶段当CL小于1057的时候L1=L其余阶段L1为低电平，L1取反为L2;当1057
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