基于FPGA视频采集中的I2C总线设计与实现

4设计仿真结果
设计中利用QuartusⅡ集成环境采用VHDL语言实现了I2C总线对SAA7111中集成的symbol进行实验仿真。reset信号为外接复位信号，时钟信号根据需要外接所需频率时钟信号(clk)，并根据要求对信号进行16分频作为进程激励信号(clkin)。对于上述初始化数据，仿真波形如图5所示仿真结果输出正确后，配置与电路设计相符的入／输出引脚。根据测试结果，该设计可以稳定可靠地对SAA7111进行参量控制，如果需要修改只需更换程序中参量，再次编译下载即可。

5 结语
该设计在视频采集处理系统中已得到应用，I2C总线接口数据采集正确、稳定，并且在实现过程中，占用资源少，仅为总资源的40 ％。核心器件与图像数据采集芯片配合使用，节省核心处理芯片的通用I／O接口，使系统整体电路十分简洁、可靠性高、集成度高、接口方便等优点。