基于FPGA的摄像机传感器接口实现
一个实际例子是，针对Aptina Imaging的HiSPi串行接口至TI DSP并行接口的桥接，LatticeXP2-5非易失性FPGA提供了高效、具有成本效益的解决方案，如图4所示。
该参考设计在输入端用HiSPi串行接口，在输出端用TI TMS320DM3X5连接至Aptina传感器。*估硬件已测试了Aptina的A-1000传感器MT9M034/MTM024和MT9J003。该参考设计支持分组（Packetized）和Streaming SP HiSPi格式：1-4通道运行速度高达每通道700Mbps。它还模拟并行传感器输出，输出总线宽度为8、10、12、14或16位。并行接口可配置为1.8V、2.5V或3.3V LVCMOS电平。参考设计的模块图如图5所示。
图5 参考设计的模块图
FPGA在传感器接口桥接上的挑战
可编程逻辑作为图像传感器和ASSP之间的桥接面临三个方面的挑战。首先，FPGA必须为接口信号提供电信号支持。第二，FPGA的I/O必须有足够的gearing逻辑来支持快速串行传感器接口。第三，FPGA必须提供符合成本效益的非常小的外形尺寸，以适应现代摄像机对于紧凑外形的要求。
具有完备子LVDS文档支持的LatticeXP2非易失FPGA系列已被证实解决了图像传感器桥接的电气需求。集成PLL、专用时钟沿和I/O gearing逻辑解决了高速串行传感器接口。最后，莱迪思半导体（Lattice）的 XP2提供了具有成本效益的8×8mm面积。此外，由于其非易失的特性，LatticeXP2系列器件无需外部引导PROM，从而进一步节省了电路板空间，这使得他们成为传感器接口的具有吸引力的可编程逻辑平台。图像信号处理（ISP）IP的可用性也使更大型的LatticeXP2器件可提供各种功能，如传感器数据线性化、传感器寄存器编程、去Bayering、有缺陷的像素校正、伽玛校正和每个色通道高达24位的简单HDR。
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