九项常被忽略的ADC技术指标

　　孔径抖动，ADC的内部时钟不确定性。ADC的噪声性能受内部和外部时钟抖动限制。

　　在典型的数据手册中，孔径抖动仅限转换器。外部孔径抖动以均方根方式与内部孔径抖动相加。对于低频应用，抖动可能并不重要，但随着模拟频率的增加，由抖动引起的噪声问题变得越来越明显。如果不使用充足的时钟，性能将比预期要差。

　　除由于时钟抖动而增加的噪声以外，时钟信号中与时钟不存在谐波关系的谱线也将显现为数字化输出的失真。因此，时钟信号应具有尽可能高的频谱纯度。

　　孔径延迟，采样信号的应用与实际进行输入信号采样的时刻之间的时间延迟。此时间通常为纳秒或更小，可能为正、为负或甚至为零。除非知道精确的采样时刻非常重要，否则孔径延迟并不重要。

　　转换时间和转换延迟，这是两个密切相关的技术指标。转换时间一般适用于逐次逼近型转换器(SAR)，这类转换器使用高时钟速率处理输入信号，输入信号出现在输出上的时间明显晚于转换命令，但早于下一个转换命令。转换命令与转换完成之间的时间称为转换时间。

　　转换延迟通常适用于流水线式转换器。作为测量用于产生数字输出的流水线(内部数字级)数目的技术指标，转换延迟通常用流水线延迟来规定。通过将此数目乘以应用中使用的采样周期，可计算实际转换时间。

　　唤醒时间，为了降低功耗敏感型应用的功耗，器件通常在相对不用期间关断，这样做确实可以节省大量功耗，但器件重新启动时，内部基准电压源的稳定以及内部时钟的功能恢复都需要一定的时间，此时转换的数据将不满足技术指标。

　　输出负载，同所有数字输出器件一样，ADC(尤其是CMOS输出器件)规定输出驱动能力。出于可靠性的原因，知道输出驱动能力比较重要，但最佳性能一般是在未达到完全驱动能力时。

　　在高性能应用中，重要的是，将输出负载降至最低，并提供适当的去耦和优化布局，以尽可能降低电源上的压降。为了避免此类问题发生，许多转换器都提供LVDS输出。LVDS具有对称性，因此可以降低开关电流并提高总体性能。如果可以，应该使用LVDS输出以确保最佳性能。

　　未规定标准，一个至关重要的未规定项目是PCB布局。虽然可规定内容的不多，但它会显著影响转换器的性能。例如，如果应用未能采用充足的去耦电容，就会存在过多的电源噪声。由于PSR有限，电源上的噪声会耦合到模拟输入中，并破坏数字输出频谱，如图4所示。

　　图4a. 电容与性能 图4b. 有限电容与性能