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基于AD6620的数字下变频(DDC)的频率变换器

作者: 时间:2010-11-19 来源:网络 收藏

的控制接口分串行输入和并行输入两种。由于使用FPGA做芯片配置逻辑,所以,本文选用较灵活、效率较高的并行数据作为配置接口的逻辑输入。

内部各个模块的配置寄存器并不是等位长的。具体各模块内部配置寄存器的位长见表l所列,而内部寄存器的访问则必须通过外部接口寄存器来指定地址,并由高位到低位按字节写入。

  外部接口寄存器的位长是固定的,按000到lll编址总共八个。其中低5位的5个寄存器是数据寄存器,可用于放入内部某地址的不定长数据。而高两位的两个寄存器是地址寄存器,用于存放将要访问的内部寄存器的目标地址,其中最高位111寄存器又和模式控制寄存器复用,且其最高两位标识为写增长和读增长,具体结构如表2所列。



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