基于LabVIEW的数字虚拟芯片构建方法及应用
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图2中2个图标为同一VI在LabVIEW中的2种不同显示方式，且2个图标为同一VI分别以不同文件名保存的2个文件。(程序完全相同)
2．2 基于虚拟JK触发器及LabVIEW虚拟“逻辑门”构
虚拟仪器LabVIEW中的逻辑运算VI，可以完成各种基本逻辑运算，在仿真数字逻辑电路时可当作虚拟的“门电路”直接使用，部份图标如图3所示。
集成计数器74161的内部逻辑图如图4所示。本文引用地址：//m.amcfsurvey.com/article/187758.htm
它是4位二进制同步加法计数器，有异步清零、预置数端子和两个使能控制端子，各端子的含义如下：
(1)RD：异步清零端，低电平有效
(2)LD：预置数使能控制端，低电平有效
(3)预置数据输入端：A、B、C、D
(4)CP；时钟输入端，上升沿有效
(5)状态输出端：QA～QD
(6)RCO：进位输出
74161的逻辑功能：
(1)异步清零功能：当RD=0时，不管其余输入端状态如何，计数器均被置零，且不受CP控制，故称为“异步清零”。
(2)同步并行预置数功能：当RD=1且LD=0时，每一个有效CP都将A、B、C、D输入端的数据传送至QA～QD状态端子接收。
(3)状态数据保持功能：当RD=LD=1，且ET·EP=0时，无论CP有无，计数器处于保持状态(QA～QD保持不变)。保持状态分2种情况：
EP=0，ET=1：进位输出RCO保持不变；ET=O，无论EP为何值，进位输出RCO=0。
(4)计数功能：当RD=LD=EP=ET=1时，电路处于正常的加法计数状态。
根据74161逻辑图，编制相应的LabVIEW后面板，结果如图5所示。从图5中可以看出，对应很好。
保留并定义所有输入端和输出端子，编辑图标，将程序保存为子VI，称之为虚拟74161芯片，其VI图标及连线端口如图6所示。
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