IBERT在FPGA中的应用
在IP Catalog窗口＼View by Function＼DebugVerification＼Chipscope Pro＼下双击Ibert，如图2所示。按顺序设置Ibert核线速率2．457 6 Gbit·s-1，数据宽度20 bit，参考时钟频率122．88 MHz，选择被测试的GTP DUAL，设置系统时钟频率66 m、位置R7等参数，IBE RT Core Summary如图3所示，点击generate生成Ibert核的可下载bit配置文件。本文引用地址：//m.amcfsurvey.com/article/190002.htm
(2)将生成的bit文件加载到单板上，显示界面如图4所示。
首先关注PLL Status状态和Clocking Setting显示的收发时钟频率，PLL Status状态Locked表明GTP_DUAL的PLL已锁定GTP的参考时钟，GTP可正常工作。如状态是Unlocked，则要检测待测GTP的参考时钟是否正常输入。
测试高速串行信号的信号质量，通常使用足够带宽和采样率的示波器测试信号眼图来评估，一但测试的眼图不符合模板要求，需要调整高速串行接口的参数。使用IBERT核可以快速完成参数修改的任务，设置Loopback Mode在开环的模式下，TX Data Pattern为PRBS7-bit，调整摆幅、预加重参数，观察示波器上的信号眼图是否符合模板要求。图5和图6分别为调整摆幅预加重参数前后的眼图，图5所示眼图对应预加重0．8 dB、摆幅495 mV，眼图的眼高太小且图形碰撞模板，调整为预加重1．7 dB、摆幅1 180 mV，眼图满足的要求如图6所示。
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