基于FPGA高精度浮点运算器的FFT设计与仿真
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然后尾数经加减运算后规格化并输出，为了以标准浮点格式输出，规格化需要前导零检测。
存储在ROM中，由实部cos(2×k×π／8)和虚部sin(2×k×π／8)两部分组成，读取由时钟单元的信号控制。由图2可以看出每一级参加蝶形运算的旋转因子不同。
(3)RAM数据地址。在整个地址单元中，分配RAM中数据的地址是重点，8点蝶形运算共需16个存储单元，数据地址的产生遵循一定规则。例如，Butterfly的信号为“a3a2a1a0”，则x，y的地址产生规则如表1所示。本文引用地址：//m.amcfsurvey.com/article/190672.htm
数据的读取靠时钟信号来控制。
1．4 FFT仿真结果分析
图7中输入8点数据为[-l，1，2，-0．5，-3，-1，2，0]。仿真结果经转换后，用10进制表示的最后结果为[0，3．76775-1．06065i，-8-0．5i，0．23225-1．06065i，0．5，0．23225+1．06065i，-8+0．5i．3．76775+1．06065i]。Matlab仿真后结果为[-0．5000，3．7678-1．0607i，-0．8000-0．5000i，0．2322-1．0607i，0．5000，0．2322+1．0607i，-0．8000+0．5000i，3．7678+1．0607i]两结果很接近，误差较小，仿真结果正确。
2 结束语
文中在分析了FFT算法后，描述了运算的蝶形单元，地址生成单元及FFT的实现过程。从实际设计出发，完成了基于FPGA的单精度浮点运算器的FFT设计，精度达到10-6。其输出结果与Matlab仿真结果相近，达到了利用FPGA实现FFT的目的。
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