基于FPGA的高阶QAM调制器的实现

　　用相位累加器输出的数据作为波形存储器(ROM)的相位取样地址，这样就可以把存储在波形存储器内的波形抽样值经查找表查出，完成相位到幅值转换。ROM设计的关键问题是进行初始化，就是将正弦波的二进制幅度码按一定的格式输入到存储器初始化(.mif)文件，此文件可以C语言或者Matlab语言程序生成。

　　DDS系统输出信号的频率为f0=fclk×M／2N，频率分辨率为△f=fclk／2N，当M=2N-1时，DDS最高的基波合成频率为f0max=fclk／2。对于本系统，时钟频率fclk=155.520 MHz，N取12。仿真结果如图4所示。

　　由于两个正交本振的形成是通过Madab运算得到的查找表，所以由DDS得到的载频不存在幅度差异，理论上其正交性也完全可以得到保证，但由于存储精度的影响，存在量化误差。

　　4 系统设计与仿真

　　根据以上各模块单元的设计，构成64QAM调制器的顶层文件如图5所示。运用QuartusⅡ及Matlab软件实现64QAM调制器仿真，仿真结果如图6所示。

　　5 结 语

　　本文介绍了用FPGA实现全数字高阶QAM调制器的思想和方法，采用原理图和Verilog语言，用可编程芯片StratixⅡ系列中的EP2S30F484C3实现了整个设计，结果表明符合设计要求。为进一步的研究和设计全数字高阶QAM系统打下了良好的基础。