基于FPGA的音频编解码芯片接口设计
数字输出支持4种音频数据模式：右对齐、左对齐、I2S和DSP模式。通过对寄存器的不同配置，可以设置传输的数据格式。寄存器配置值如下：
寄存器地址0000111的1～0位设置音频格式：“11”时为DSF’格式，“10”为I2S格式，“01”为左对齐格式，“00'’为右对齐格式。
3～2位设置字长：“11”时为32位，“10”为24位，“01”为20位，“00'’为16位。
这四种音频格式都是高位(MSB)在前，16～32位。但32位数据不支持右对齐模式。
本文采用主模式的左对齐数据格式，左对齐数据格式传输如图3：左对齐格式时，MSB在BCLK的第一个上升沿有效，紧接着是一个ADCLRC或DACLRC传输。本文引用地址：//m.amcfsurvey.com/article/192031.htm
3 WM8731芯片驱动的FPGA设计
3.1 驱动器的总体设计方案
本文设计驱动器在使用时的框图如图4所示。双口RAM和驱动器一同连接在控制器的数据总线和地址总线上，控制器只需提供少量的控制线即可完成对音频编解码芯片wM8731的控制及数据交换功能。
驱动器内部结构框图如图5所示。控制部分提供驱动器与控制器之间的接口(包含有数据总线信号、地址总线信号和控制信号)，同时产生控制字转换单元和数字音频接口单元的控制信号；内部寄存器缓存控制字和状态字；控制字转化单元负责将控制字串行发送给WM8731，同时效验传送信号；数据音频接口单元完成WM8731与外部双口RAM的串并转换，实现对数字音频信号的发送和接收功能。
驱
表l 状态寄存器控制字的对应定义
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