基于FPGA的FIR数字滤波器设计方案(一)

　　3.1FIR数字滤波器模块设计与系统级仿真

　　根据FIR数字滤波器的原理，在Simulink环境下搭建16阶的FIR数字滤波器结构，如图3所示。

　　在模型的搭建过程中，使用了两个8位的Shift Taps移位寄存器模块对输入信号进行分解，然后根据数字滤波器的原理进行算法计算。