基于MSI的N进制计数器设计方法

计数器是数字逻辑系统中的基本部件，它是数字系统中用得最多的时序逻辑电路，其主要功能就是用计数器的不同状态来记忆输入脉冲的个数。除此以外还具有定时、分频、运算等逻辑功能。计数器不仅能用于对时钟脉冲的计数，还可使用于定时、分频、产生节拍脉冲以及进行数字运算等。只要是稍微复杂一些.

　　采用中规模集成计数器来设计任意进制计数器，使设计和调试工作更趋于简单，并且具有体积小，功耗低，可靠性高等优点。本文主要阐述了用中规模集成计数器设计任意进制同步加法计数器的设计思想，并对设计方法和步骤作了讨论。

　　2.MSI中规模计数器概述

　　2.1MSI中规模计数器芯片种类

MSI中规模计数器芯片有非常多的种类。若按触发时钟的方式分类有：同步计数器、异步计数器；若按进制的“模”分类有：二进制计数器、十进制计数器；若按计数的方式分类：有加法计数器、减法计数器和可逆（加/减）计数器；若按芯片的型号分类就更多了，如：仅74系列的4位二进制计数器芯片就有161、163、191、193、197等，十进制计数器芯片有160、162等。

　　2.2MSI中规模计数器工作原理

　　2.2.1.以十进制同步计数器74LS160为例

　　74LS160的功能

表174LS160功能表

　　根据功能表，74LSl60的功能说明如下：

　　（1）异步清零功能。当CR=0时，不论其他输入如何，输出Q3Q2Q1Q0为0000，表中“×”表示任意。

　　（2）同步并行置数功能。LD为预置数控制端，在CR=1的条件下，LD=0时，在CP上升沿的作用下，预置好的数据d3d2dld0被并行地送到输出端，即此时的Q3Q2Q1Q0为d3d2dld0。

　　（3）保持功能。在CR=1和LD=1的前提下，只要TTTP=0，则计数器不工作，输出保持原状态不变。

　　（4）计数功能。正常计数时，必须使CR=1，LD=1，TTTP=1，此时在CP的上升沿的作用下，计

　　数器对CP的个数进行加法计数。当计数到输出Q3Q2Q1Q0为1001时，C0=1，C0=1的维持时间是从Q3Q2QlQ0为1001时起到QaQ2Q1Q0状态变化时止。

　　74LS161功能
表274LS161功能表

　　从功能表（一）可以看到，74LS161处于计数状态时，引出端RD，LD，S：，S：都应为“1”（接高电平）。如果取其中一片T4161作为低位计数器〔记作（1）〕，对该片计数器来讲，每来一个CP就计一次数，它始终工作在计数状态。

　　3.设计方案

　　3.1采用反馈置零法来设计任意进制计数器

　　对于74LS160属于异步置零输入端的计数器，它是当置零输入端出现有效电平（低电平）后计数器立即被置零，不受时钟信号的控制。而对于74LS162/74LS163属于同步置零输入端的计数器。它是当置零输入端出现有效电平（低电平）后计数器并不会立即被置零，必须等下一个时钟信号到