DDR3存储器接口控制器IP加速数据处理应用

设计和验证流程

DDR3存储器控制器IP核必须易于配置、生成并应用到一个目标设计中。使用图形化用户界面（GUI）来配置各种DDR3控制器参数是一种简便的方法，为目标系统快速创建正确的控制器。所有的参数都需要确定，如：存储器宽度、深度、速度和延迟。每一类配置参数都有其独立的选项卡，有助于将设计任务分为一个个可管理的“任务块”。一旦参数选定，生成代码（用VHDL或Verilog）和生成相应的测试基准应当是比较容易的。

　　例如，莱迪思IPexpress工具只需三个步骤，如图3所示，在ispLEVER设计软件中创建ECP3DDR3存储器控制器IP核：

　　1)从莱迪思网站下载IPexpress工具并将IP核导入。

　　2)IP核参数可通过每个配置组对应的选项卡进行选择，配置组有：类型、设置、时序、引脚和设计工具。

　　3)基于Verilog或VHDL的IP核和测试基准一起生成，包括顶层、监视器、指令生成器、用于Aldec或ModelSim的配置和脚本文件。

　　图3：下载、配置和生成IP核设计流程

小结

　　在数据处理应用的设计中，如本文中视频处理的例子，当存储器具有足够的带宽时，可以充分利用FPGA的并行处理能力的优势。DDR3存储器具有灵活、易于使用的存储器控制器，如：莱迪思ECP3 DDR3存储器控制器IP核，加上正确使用突发模式访问、数据缓冲器分配和存储器交叉存取可以大大加快数据处理速度。此外，一个经验证的IP核与可靠的设计和验证环境也加速了这些应用的上市。