FPGA与ADSP TS201的总线接口设计方案

1．2 突发流水线协议

　　因为数据总线位宽小于数据位宽，那么它只能通过两次传输来完成。但是如果DSP没有任何指示信号，FPGA并不知道当前传输是高32位数据，还是低32位数据，这时候另外一个信号BURST就显得尤为重要了。

　　引脚BRST可以用来指示多个传输过程合成一个传输过程，图2是DSP通过32位数据总线写64位数据时序图。

　　由图2可以看出，数据传输机制与普通流水协议相同，只多了一个BRST指示信号，它与地址1同时有效，表示本次数据没有传输完毕，下次要传输的数据与本次传输的数据是一个整体，即BRST有效时传输是低32位数据，无效时传输的是高32位数据，这样就实现了在32位数据总线上传输64位数据，如果没有BRST信号，该过程会被认为是2次32位传输。

　　同理，如果用32位数据总线传输128位数据，在传输前3个32位数据的时候，BRST信号有效，传输最后一个32位数据BRST无效。

　　注意：使用流水协议时，流水深度由传输类型(读数据还是写数据)决定。在写数据传输中，流水深度固定为1；在读数据传输中，流水线深度可由用户编程决定，即由系统配置寄存器SYSCON决定，在1~4之间可变。

2FPGA设计

　　由于DSP的协议是相对固定的，FPGA只需按照协议进行设计即可，下面以DSP访问FPGA内部寄存器为例详细介绍。笔者建议采用同步设计，主要信号、输出信号都由时钟沿驱动，可以有效避免毛刺。

　　为了使所设计的模块通用化，可设流水深度、数据总线位宽、寄存器位宽、寄存器地址可设。笔者建议采用参数化设计，使用参数传递语言GENERIC将参数传递给实体，在实体内部使用外if…else结构，这样在一个程序中可以包含各种情况，但不会增加逻辑的使用量。下面以个别情况为例，详细介绍。