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EnDat接口编码器数据采集设计方案

作者: 时间:2013-04-07 来源:网络 收藏
位置值如果带附加信息,紧接在位置值后的是附加信息1和2,他们也各以一个CRC结束。附加信息的内容由存储区的选择地址决定,然后在后面的采样周期里被传输。在后续的传输中一直传输该信息,直到新的存储区被选择。在数据字的结尾,时钟信号必须置高电平。10us到30us或1.25us到3.75us(EnDat2.2可编程的恢复时间tm)后,数据线回到低电平,然后,新的数据传输可在新的时钟信号下开始。

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图3 带附件信息的位置传输同时,为参数提供了不同的存储区,它们可以被后续电子设备读取,这些区域可以被制造商、OEM厂商甚至最终用户写入。一些特定的区域是可以被写保护的。不同系列的支持不同的OEM存储区和不同的地址范围。因此,每一个编码器必须读取OEM存储区的分配信息。基于此原因,后续电子电路应基于相对地址编程,而不能使用绝对地址。

后续电子设备的电路设计方案

使用者可以根据协议和电路电气特性自行设计接口电路进行与处理,同时海德汉也提供了特定的数据处理芯片供用户选择。如果用户自行设计电路,需遵循的电气特性,并需要掌握EnDat接口的协议,保证严格遵循协议的时序要求和数据帧格式。而如果采用海德汉提供的数据处理芯片,则可以简化设计,用户只需配置FPGA的寄存器,按照芯片可接受的指令格式发送指令,就可获得需要的数据。

通过遵循RS 一485 (差分信号)标准的收发元件,在后续电子设备发出的同步时钟激励下,数据(位置值和参数)可以在编码器和后续电子设备之间双向传输。

四 FPGA+软件宏

海德汉的合作伙伴MAZet公司针对Xilinx公司的Virtex和Spartan系列及Altera公司的Acex和Cyclone系列提供了EnDat协议的软件宏,根据客户需求,MAZet公司还可以提供定制软核。该软核实现了EnDat接口的所有功能,用户可通过6位地址线和16位数据线与微控制器进行8位或16位的数据传输。下面是FPGA的模块图和电路设计。

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图4 FPGA模块图

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图5 编码器和后续电路连接模块图五 结束语

海德汉公司的EnDat接口在很多行业已得到广泛的应用,现在它又被提升到崭新高度。双向EnDat 2.2接口的时钟频率现已提高到16 MHz,能满足直接驱动这类高动态性能要求的应用,特别是电子工业的应用,时钟频率从8 MHz提高到16 MHz不仅将大大缩短读取位置信息所需时间,还可以大幅缩短控制环的周期。同时简单、经济的系统设计为客户提供了方便,强大的功能和通用性及具有前瞻的安全设计理念引导编码控制技术不断向前发展。(end)


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