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VIVADO导出硬件时没有export hardware for sdk选项【Zynq】 Yker \|浏览：10154 \|回复：4 \| 赵奇2019-06-12 23:03:17
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XC6SLX16内部是否可被加密【Zynq】 nahlj \|浏览：3309 \|回复：0 \| nahlj2019-05-04 14:53:48
请问各位zynq PL端如何读写ddr啊？？ simonmao8385 \|浏览：8963 \|回复：2 \| melau2019-04-12 15:52:59
为配合xilinx的活动，现贡献全志A20原理图一份 machinnneee \|浏览：3632 \|回复：1 \| melau2019-04-12 15:50:08
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SPARTAN -3 系列XC3S400的下载和配置问题【硬件优化】 trunftec \|浏览：2247 \|回复：0 \| trunftec2019-01-12 15:43:47
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usb_verilog 有很详细的英文说明，外添一份大连理工的论文，一起看包你完全理解usb,最后是usb_jtag 的verilog状态机 dongzhiL332 \|浏览：4956 \|回复：9 \| GUIWENJING2017-12-25 10:11:12
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SPARTAN 3AN系列 excel footprint xiaolin4006 \|浏览：1193 \|回复：0 \| xiaolin40062017-12-18 21:31:47
国外一大学的SPARTAN-3E开发板的实验例子（含代码很经典） jiangnanyu \|浏览：16386 \|回复：46 \| cuiapei2017-12-07 21:06:22
请问用过Spartan6系列的产生的MIG的吗？MIG产生的源代码只能是verilog吗？可以选择VHDL吗？ tanyushuang727 \|浏览：2371 \|回复：1 \| jhy2222222017-11-22 19:59:54
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V3学院杯开发大赛【ZingBoard开发手记】 zhaocheng2006 \|浏览：1450 \|回复：2 \| eepwnet2017-10-17 14:07:49
V3学院杯大赛【ZedBoard开发手记】 zhaocheng2006 \|浏览：1440 \|回复：3 \| eepwnet2017-10-17 14:07:34
求助irda红外 SIR 协议的发送接收 VHDL设计【Zynq】 xiaozhengzheng \|浏览：1512 \|回复：0 \| xiaozhengzheng2017-09-03 22:14:33
书上第一个实验我的超级终端显示的不太对 simonmao8385 \|浏览：1709 \|回复：2 \| machinnneee2017-07-31 16:06:56
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有用zynq处理器的前辈帮帮我吗？【Zynq】粪海狂蛆 \|浏览：2092 \|回复：0 \| 粪海狂蛆2017-05-16 19:05:33

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