FPGA的宽带步进频率信号源设计

测频单点频率输出为1．5 GHz，频谱分析仪的SPAN宽度为50 MHz，输出功率为0．22 dBm，相位噪声为-93．83 dBc@10kHz，测试结果如图5所示。

由FPGA配置，设定每个步进频点的保持时间为100 μs，通过频谱分析仪，测试宽带步进频率的功率值，结果如图6所示。

根据测试结果，本方案设计各项指标基本满足设计要求。由于传输线的衰减和反射作用，导致步进频率扫描输出功率不够平稳。本文设计的宽带步进频率源的后级可通过扩展数控衰减器、放大器、选频滤波器等网络，将有利于调整输出功率的平稳度和带外杂散抑制。

结语
本方法设计的LS波段宽带步进频率信号源结合了DDS和锁相环芯片二者的优点，在FPGA的综合配置、控制下完成了满足要求的频率源设计要求。如果将VCO的基准电压更新频率按其16重叠频段设置，即整个频率输出仅更新16次基准电压，那么在单个VCO线性区间，输出频率的稳定时间将为纳秒级，该方法将在后期的设计中重点研究。采用本方法设计的宽带步进频率源具有集成度高、频率稳定性能好、电路简单、低功耗等特点。同时，该频率源作为通用电子设备频率源，可通过FPGA配置输出135 MHz～4．4 GHz的带宽输出，具有广泛的工程实用价值。