基于FPGA的ISA总线／MMи总线数据转换电路设计
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该配置电路采用PS配置方式，首先通过QuartusⅡ软件将FPGA的逻辑程序写入配置芯片EPC2LI20，该芯片数据具有掉电保护功能。上电后，配置芯片和FPGA同时复位，然后FPGA向配置芯片发送程序下载请求，配置芯片将存储的逻辑程序写入FPGA，对FPGA进行配置．配置完成后，FPGA内部的寄存器和I／O管脚均被初始化。完成初始化程序后，FPGA按照设计的逻辑功能正常工作，即按要求实现两种总线之间的数据转换。
2．3 地址比较电路
地址比较电路如图3所示。74SL14为带滞环比较的反向缓冲器，74SL85为4位数字比较器，6位的拨码开关为预存待转数据程控模块地址，74SL00为反向缓冲器。拨码开关共有6位，每1位都可以是逻辑高电平“1”或是逻辑低电平“0”，故该拨码开关共有26个组合，可以代表26个程控模块的地址。如图3所示，拨码开关为011001，代表将要进行转换的数据来自地址为011001的程控模块，当控制信号给定的地址A27～A22与011001相符时，74SL00输出低电平，该低电平与ISA总线的读控制信号IOR和写控制信号IOW#一起构成FPGA从ISA总线读数据或向ISA总线写数据控制信号。本文引用地址：//m.amcfsurvey.com/article/190276.htm
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