基于FPGA的多项式运算器设计

从图2中可以看到，输出有大约3～4个时钟的延时，对比CPU执行1条指令就需要3～4个时钟，运算效率已经很高，而且这里使用的逻辑资源很少。

4 实验结果分析
多项式拟合函数会有误差。这里只分析运算器相对多项式的误差。因为数据位宽有限，会出现截断误差。设计实例采用8位小数位，最大表示误差是±2-9。由于常数也有数据截断，实际运算误差会更大。
减小误差的惟一办法是增加数据的位数。在本例中将数据上传电脑并测算，最大误差在x=π／2处，绝对值是0．0063，相对值是0.63％。对于一些特殊的输入如x=0或x=0．5等，运算没有误差。

5 结语
通信系统的仿真与硬件实现涉及到很多复杂的函数，直接实现会造成资源浪费，而且实现难度比较大。采用FPGA实现多项式运算，实现起来比较简单，为之后实现复杂函数提供了基础，大大提高了运算速度和实现效率，在通信系统的硬件实现上有很广阔的应用前景。