基于FPGA数据流控制动态可重构的实现
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3 可重构系统的单元结构搭建
根据4输入LUT的结构原理，本电路选用2个4输入的MUX用来选择与非门的输入端口，然后用1个2输入的MUX选择数据的输出，3个MUX的选择位分别用SelB[1，0]，SelA[1，0]，Sel-out控制，移位寄存器作为5位串行二进制数的缓存，如图6所示。可知，与非门可以通过东西南北4输入的选择组成各种数字电路，这种单元结构可以继续扩展为2×2或更多单元，实现复杂的数字电路。这里演示单元结构形成的与门和或门的简单结构，进一步说明可重构的可实现性。本文引用地址：//m.amcfsurvey.com/article/191232.htm
当产生数据流经过缓存进行重构电路后，可以看到新的熟悉电路所实现的功能，如图7所示。通过观察输入和输出端的关系，测试得到所需电路的最佳方案，即可下载到硬件，完成所需任务。
4 硬件平台结构
硬件结构是基于单片机与FPGA的通信。Mcu选择MSP430，通过RS232和FPGA进行通信，PC机通过JTAG接口向中心芯片下载程序。外围设备中，选择2个8位LED，4位输入按键，1个12864液晶显示，预留32位的扩展接口。如图8所示，FPGA选择的是Ahera的EP1C16Q240C8。
5 结束语
实施电路可重构技术，已成为计算系统研究中的新热点，使硬件逐渐软件化，通过微处理器结合多个FPGA对其进行配置，实现动态局部可重构，具有较强的通用性和自适应性，适用于模块化设计。本文基于5 bit数据流，实现了FPGA的部分动态可重构，可以实时生成所需要的硬件结构。动态可重构可以充分利用可重配置硬件，尤其是可重配置计算方面。该技术在理论上有较大发展，FPGA未来的发展方向之一就是做支持动态可配置的SOPC硬件。
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