应用EDA仿真技术解决FPGA设计开发中故障的方法

　　针对这三个问题，笔者提出如下想法：

　　虽然定位具体的出错信号很困难，但是定位是哪个模块出错很容易，在bug出现的时候我们可以抓出这个模块的全部输入信号，考虑是否可以利用这些信号在仿真环境下重建bug出现的条件，利用仿真环境具体定位错误信号的位置。

　　定位好错误信号的具体位置后，修改代码，再用相同的条件进行仿真。这样可以通过对修改前后输出数据的对比，很直观的验证修改是否成功，从而在修改成功后只需编译一次即可，节省时间。

　　上板后bug不复现也可以排除是由于极端情况很难满足造成的，去除了后顾之忧，彻底解决了故障。

仿真解决故障的方法

　　通过对这个异步FIFO问题的解决，可以证明这种通过所抓信号建立bug存在条件，定位、清除bug的方法是可行的。步骤如下：

　　①将bug出现时SignalTap抓的信号保存成文档文件

　　Quartus II 平台用SignalTap抓到信号的界面如图2所示。

　　图2 SignalTap抓信号界面

　　在信号名称上单击右键，选择图2所示Create SignalTap II List File选项，生成如图3格式界面。

　　图3 SignalTap II List File界面

　　图3中界面上半部分显示的是list对信号个数及信号名的描述，下半部分是采样点所对应的信号值，带h的表示是十六进制数值。