对基于FPGA的作战系统时统的研究与设计

　　其中CLK(时钟)、RST(复位)、A(外部授时信号)、B(自产生信号)为输入信号。Y为输出信号，即中断信号。仿真结果如图4所示。

　4 时间精度

　　外部授时信号大多为1秒周期的秒脉冲信号，这时系统获得的时间只能精确到秒。在需要获得精确度更高的时间信息时，可利用FPGA中的计数器等来实现设计。见下面所示：