基于ADSP-BF561的车辆辅助驾驶系统硬件设计

　　有源品振信号质量好、比较稳定、连接简单和不需要复杂的配置电路。因此ADSP-BF561系统输入时钟采用30MHz的外部有源品振然后通过其内部锁相环PLL把频率进行相应的倍频作为ADSP-BF561的总线频率和SDRAM的时钟频率，同时由于并行输入，输出外围接13和视频编解码芯片的时钟需要，需要把27MHz有源晶振通过IDT2305分成4路输出。

2．3存储扩展电路

　　SDRAM是同步寻址存储器，由块、行和列组成．全部读店操作锁定于一个处理器源时钟，一旦处理器对SDRAM进行初始化。该存储器必须不断更新，以确保能保持它的状态．SDRAM的时钟速率可变，工业上最常用的是PCI00和PCI33，最高时钟频率分别为100MHz和133MHz。ADSP-BF561拥有SDRAM控制器(SDC)与SDRAM的无缝连接，其连接如图2(a)所示，系统采用MT48LCl6M16A2，容量为32MHz，最高频率为133MHz。

　　ADSP-BF561具有异步存储器控制器(AMc)，与SDRAM控制器共享数据和地址引脚。当上电复位或者软件初始化复位后．处理器采样复位配置寄存器BMODE引脚，执行引导功能。系统采用BMODEIO为由8116位Flash引导模式，并选用NORFLASH作为引导代码存储器，所选芯片为容量8MB的M29W640DT．其连接方式如图2(b)所示。

a) SDRAM

b)Flash

图2存储器连接