“RISC-V势不可挡,” 暌违中国数年的RISC-V主要发明人、SiFive共同创办人兼首席架构师Krste Asanovic教授,在近日刚刚圆满落幕的2023 SiFive RISC-V中国技术论坛北京、上海、深圳三地巡回演讲时,始终强调了这一核心思想。 起步于2010年的RISC-V架构已经度过了最初的蛰伏期,在2022年就已实现100亿颗的出货量,据Asanovic教授预测,未来五年RISC-V将迎来迅猛增长,截止2025年RISC-V处理器核的出货量将达到800亿颗,而这仍是保守估计。
关键字:SiFive RISC-V 垂直半导体时代
IT之家 6 月 30 日消息,据《半导体产业纵横》报道,中科院计算所等机构用 AI 技术设计出了世界上首个无人工干预、全自动生成的 CPU 芯片 —— 启蒙 1 号。该 CPU 基于 RISC-V 的 32 位架构,其相比于 GPT-4 目前能够设计的电路规模大 4000 倍,性能与 Intel 486 系列 CPU 相当,可运行 Linux 操作系统。▲ 图源中科院计算所论文这是全球首个无人工干预、全自动生成的 CPU 芯片,65nm 工艺,频率达到了 300MHz,相关研究论文已经在今年
关键字:RISC-V CPU AI
我们在上一篇技术白皮书《基于形式验证的高效RISC-V处理器验证方法》中,以Codasip L31这款用于微控制器应用的32位中端嵌入式RISC-V处理器内核为例,介绍了一个基于形式验证的、易于调动的RISC-V处理器验证程序。它与RISC-V ISA黄金模型和RISC-V合规性自动生成的检查一起,展示了如何有效地定位那些无法进行仿真的漏洞。RISC-V的开放性允许定制和扩展基于RISC-V内核的架构和微架构,以满足特定需求。这种对设计自由的渴望也正在将验证部分的职责转移到不断壮大的开发人员社群。然而,随
关键字:形式验证工具 RISC-V 验证
(中国|上海)2023年6月14日 - 在Embedded World China首届展会举办期间,嵌入式开发软件和服务的全球领导者 IAR 与国产领先高性能MCU厂商先楫半导体(HPMicro)共同宣布达成战略合作协议:IAR 最新的 Embedded Workbench for RISC-V 版本将全面支持先楫HPM6000高性能RISC-V MCU系列,这是IAR 首次支持高性能通用RISC-V MCU产品系列。IAR为先楫半导体的创新产品提供全面的开发工具支持,包括
关键字:IAR 先楫 RISC-V MCU
指令精简、模块化、可扩展……已于2022年利用7年时间达成出货量100亿颗的里程碑,RSIC-V正在充分发挥自身的开放开源优势,一路开疆拓土。身为RISC-V的发明者与领导厂商,SiFive正发挥开源生态叠加未来计算新范式的“链主”效应,致力于将RISC-V的无限潜力引领至高性能处理器与高算力场景应用中。 同时,100亿颗RISC-V处理器芯片中,近一半产自中国的亮眼数据有目共睹,RISC-V在中国市场信心持续走高,在此大环境背景下,SiFive亲自运营中国市场与业务,希望和中国一起见证RISC
关键字:SiFive RISC-V
IT之家 6 月 12 日消息,Debian 是最为古老的 GNU / Linux 发行版之一,该操作系统以稳定性为重,不追求高速迭代,因此在新版本发布很早以前,就会揭晓一系列新特性。目前 Debian 项目宣布,在未来的 Debian 13 “Trixie” 中,将带来 RISC-V 64 位支持。日前 Debian 发布团队分享的更新邮件中,Debian 开发人员 Jonathan Wiltshire 透露了 RISC-V 架构下 Debian 的现状:“虽然 RISC-V 64 位移植在此
关键字:RISC-V
IT之家 6 月 2 日消息,三星、英特尔、英伟达、高通、联发科、谷歌等 13 家 IT 和半导体企业今日在比利时布鲁塞尔正式发起全球 RISC-V 软件生态计划“RISE”。据介绍,该计划旨在加速 RISC-V 新架构的软件生态建设及应用商业化进程,推动 RISC-V 处理器在移动通信、数据中心、边缘计算及自动驾驶等领域的市场化落地。RISE 创始董事会包含 13 名成员:谷歌、英特尔、平头哥、三星、联发科、英伟达、高通、Andes、Imagination、Red Hat、Rivos、SiFive、Ve
关键字:RISC-V
近两年,RISC-V 作为 IT 产业链中国产替代中的重要一环备受关注。这个基于 BSD 协议开源,基金会总部设在瑞士的开源指令集也一直被视为 X86 和 ARM 强有力的竞争对手。不过,由于起步较晚,性能与生态尚未成熟,RISC-V 以往更多地是用在物联网领域。今年,算能科技基于阿里平头哥玄铁 C910 开发了一台 64 核 RISC-V 服务器 SG2042。这一动作则拉开了 RISC-V 挺入云计算领域的序幕,2023 也被业界看做是 RISC-V 进入云计算的元年。本期开源访谈我们邀请中国电信研究
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在ARM、X86芯片架构之后,最被大家看好的芯片架构就是RISC-V了。特别是中国芯片厂商,纷纷拥抱RISC-V架构,原因在于RISC-V架构是开源免费的,不怕被人卡脖子。所以我们看到中科院、阿里纷纷推出了众多的RISC-V芯片,2022年全球出货100亿颗RISC-V芯片中,50%是中国厂商贡献的。也正因为RISC-V架构的火爆,最近全球13家知名IT巨头,成立了一个RISC-V软件生态系统 (RISE) 的指导委员会。这个委员会的目的,就是推进RISC-V芯片的落地,加速RISC-V新架构的软件生态建
关键字:RISC-V 阿里
据报道,由谷歌、英特尔、平头哥等13家企业发起的全球RISC-V软件生态计划“RISE”,在比利时布鲁塞尔正式启动。RISE旨在加速RISC-V新架构的软件生态建设及应用商业化进程,成员将联合推动RISC-V处理器在移动通信、数据中心、边缘计算及自动驾驶等领域的市场化落地。面对物联网等应用新变化,RISC-V作为新一代指令集,拥有开源、精简、灵活、可自定义的特点,相比封闭的ARM指令集,更适合专用处理器的开发,有望在IoT MCU市场迅速扩张,而后推广至数据中心等领域。我国RISC-V发展意义更加重大,在
关键字:RISC-V
RISC-V的开放性允许定制和扩展基于 RISC-V 内核的架构和微架构,以满足特定需求。这种对设计自由的渴望也正在将验证部分的职责转移到不断壮大的开发人员社群。然而,随着越来越多的企业和开发人员转型RISC-V,大家才发现处理器验证绝非易事。新标准由于其新颖和灵活性而带来的新功能会在无意中产生规范和设计漏洞,因此处理器验证是处理器开发过程中一项非常重要的环节。在复杂性一般的RISC-V 处理器内核的开发过程中,会发现数百甚至数千个漏洞。当引入更多高级特性的时候,也会引入复杂程度各不相同的新漏洞。而某些类
关键字:形式验证 RISC-V
5月9日消息,欧洲航天局(ESA)赞助、瑞士苏黎世联邦理工学院和意大利博洛尼亚大学共同开发的“Occany”(鸟蛇)处理器,现已流片。这颗处理器基于开源开放的RISC-V架构,GlobalFoundries 12nm LPP低功耗工艺,chiplet小芯片设计,2.5D封装,双芯片共集成多达216个核心,晶体管数量达10亿个,而面积仅为73平方毫米。同时,它还集成了未公开数量的64位FPU浮点单元,整合两颗美光的16GB HBM2e高带宽内存。硅中介层面积26.3 x 23.05毫米,制造工艺为65nm,
关键字:risc-v 架构 处理器
近日,2022年图灵奖颁给了“以太网之父”、3Com公司创始人罗伯特·梅特卡夫。他研发的以太网设备及其协议,允许设备连接到局域网并共享打印机和文件等资源,极大降低了网络连接成本。在中国开放指令生态(RISC-V)联盟秘书长、中科院计算技术研究所研究员包云岗看来,以太网成功的最大启示是做开放标准,它为下一步创新提供平台、拓展市场、繁荣生态,其背后的开源文化实则是一种生产方式的革新。在日前举行的开源硬件与新一代工业革命论坛上,专家表示,开源作为一种创新协作模式不仅引发了软件产业变革,未来还将引发硬件、数据、算
关键字:RISC-V
现有可用于 RISC-V 的工具可能不是最有效或最高效的。怎么办?
关键字:RISC-V
德国纽伦堡,2023年嵌入式世界展会(Embedded World 2023),2023年3月14日——Codasip和IAR共同宣布将强强联手为低功耗嵌入式汽车应用提供全新的创新支持,双方将联手为客户提供屡获殊荣的Codasip L31内核和获得安全性认证的最新版本IAR Embedded Workbench for RISC-V开发工具链。此次合作可为汽车应用开发人员提供一条便捷之道,以帮助他们推出基于多功能的Codasip L31内核且符合ISO 26262认证标准的嵌入式应用。Codasip的双内
关键字:Codasip IAR RISC-V 双核锁步技术
risc-v架构介绍
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