sloshy

菜鸟

今日你签到了吗?论坛动态

来自论坛2005-11-20 16:43

关于verilog及fpga的一些问题?

请教各位: 1。fpga是否能自己产生时钟信号。因为我看有条类似这样的语句: always #delay clk=~clk 但不知道该语句是用来测试用的还……
来自论坛2005-10-13 18:55

怎样将LDVS差分信号转换成单端信号?

谢谢……
来自论坛2005-05-30 18:09

哪位高手知道quartus II里怎么产生周期可调的随机数呢?

哪位高手知道quartus II里怎么产生周期可调的随机数呢?……
来自论坛2005-05-25 06:21

stratix GX居然不能调用???

Error: Current license file does not support device family Stratix GX -- compilation suppo……
来自论坛2005-05-24 18:36

EP1SGX10CF672C6ES的“ES”代表什么?

谢谢……
来自论坛2005-05-18 01:40

如何将单端数字信号转换为差分信号?

单端数字信号的频率在400MHz以上。 谢谢高手!……
来自论坛2005-05-14 07:29

急啊,怎么解决速率问题!!!

用fpga接受400Mbps速率的信息,然后存储转发,但是我用的cyclone II系列(外接了一个ddr sdrram)好像只能接收166M的数据,怎么解决这个问题啊? 我曾想……
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