基于FPGA的全新数字化PCM中频解调器设计
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2．2 数宇变频及滤波器设计
变频模块的设计是整个设计的关键部分之一。如图2所示，该模块由NCO、CIC滤波器、半带滤波器和FIB滤波器组成。NCO通过与A／D之后的中频信号进行混频，从而得到基带频率的I、O两路正交信号，这两路信号分别通过CIC滤波器、半带滤波器以及FIR滤波器的抽取和滤波，最终得到要求速率的数字信号，从而实现数字信号由中频频率到基带频率的转变。本文引用地址：//m.amcfsurvey.com/article/190341.htm
2．3 鉴频单元设计
从理论上来说，可以直接利用频率是相位对时间的微分关系来实现鉴频。假设瞬时频率为f(t)，瞬时相位为φ(t)，同相分量为I(t)，正交分量为Q(t)，则根据：
这就是利用I(n)、Q(n)计算瞬时频率f(n)的近似公式。
数字鉴频单元实现结构如图3所示。
2．4 跟踪环路设计
本系统设计中采用的是均匀采样二阶DPLL。
典型均匀采样二阶DPLL相位模型可以用图4来表示，它由相位检测器PD、数字环路滤波器(Digital Loop Filter)和数字控制本振(Numeri cally Control Oscillator)组成。在这个DPLL中，相位检测器PD根据输入相位或计算相位误差。相位误差通过数字环路滤波DLF并用于控制数字控制本振RCO的瞬时输出相位。在图4中，系数C1和C2是数字环路滤波器(DLF)的参数，是影响环路带宽和环路响应时间的重要参数，而C是确定DPLL中心频率的常数。这种DPLL的最大优点就是具有线性相位，从而保证了捕获时间小和锁相范围大的性能。
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