双DSP柔性处理系统研究

作者：时间：2013-09-22 来源：网络收藏

arial; TEXT-TRANSFORM: none; COLOR: rgb(0,0,0); TEXT-INDENT: 0px; PADDING-TOP: 0px; WHITE-SPACE: normal; LETTER-SPACING: normal; BACKGROUND-COLOR: rgb(255,255,255); orphans: 2; widows: 2; webkit-text-size-adjust: auto; webkit-text-stroke-width: 0px">　　3.1 图像采集与预处理模块

　　本系统中的多路选择器件选用CD4052芯片。它能根据不同的工作场合来切换红外/可见光视频输入;视频预处理电路采用AD817进行视频信号的放大，以得到更清晰的信号来进行视频处理;A/D芯片选用AD公司的AD9225，输出的8bit数字视频信号送入74LS245进行数据锁存。

　　3.2 同步分离模块

　　系统采用一款专门的视频同步分离器LM1881来从标准的负同步NTSC(PAL或SECAM)视频信号中分离出有效的行/场同步信号，并将其送入FPGA以产生系统的各级逻辑控制输出。

　　3.3 FPGA逻辑控制模块

　　由于系统中各个芯片的功能相对独立，要协调这些芯片的运作就需要一片起控制逻辑作用的可编程芯片，为此，笔者选用了ALTERAL公司的EPF10K30A，该芯片有246个用户I/O口、30000个典型门、216个逻辑阵列块、1728个逻辑单元不仅能满足系统的控制要求，而且也可以为将来系统的功能扩展提供控制逻辑。在这个光电跟踪系统中，FPGA主要用来完成如下几方面的工作：

　　(1)生成A/D采样控制时钟，实现模拟视频的正确采样;

　　(2)提供字符图形存储器地址及片选/读控制信号，并在场正程到来时，控制图形数据的读出;

　　(3)提供视频数据缓存器地址及片选/写控制信号，控制视频数据的连续写入;

　　(4)产生外部中断4至双DSP，当数据写满视频图像高速缓存预定空间时，控制主从DSP以将数据块快速搬移至片内2级缓存;

　　(5)产生外部中断7至主DSP，并在每个场逆程时刻来到时，控制主DSP擦、写字符图形存储器数据;

　　(6)产生一并/串转换电路，以将并行读入的字符图形数据串行移位输出至图形叠加电路，从而实现“+”、“□”图形在视频图像上的叠加。

　　其FPGA内部结构框图如图3所示。