- 为简化和加速复杂IC的开发，Cadence 设计系统公司不久前推出Tempus时序签收解决方案。这是一款新的静态时序分析与收敛工具，旨在帮助系统级芯片 (SoC) 开发者加速时序收敛，将芯片设计快速转化为可制造的产品。
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- Cadence日前宣布，台积电(TSMC)在20纳米制程对全新的Cadence Tempus时序签收解决方案提供了认证。该认证意味着通过台积电严格的EDA工具验证过的Cadence Tempus 时序签收解决方案能够确保客户实现先进制程节点的最高精确度标准。
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- 为设计收敛和签收提供前所未有的性能和容量 Tempus?时序签收解决方案提供的性能比传统的时序分析解决方案提升了一个数量级。 可扩展性，能够对具有上亿个实例的设计进行全扁平化分析。 集成的签收精度的时序收敛环境利用创新的考虑物理layout的ECO技术，可以使设计闭合提前数周时间。 为简化和加速复杂IC的开发，Cadence 设计系统公司推出Tempus? 时序签收解决方案。这是一款新的静态时序分析与收敛工具，旨在帮助系统级芯片 (SoC) 开发者加速时序收敛，将芯片设计快速转
- 关键字：CadenceTempus时序签收
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