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Verilog HDL基础知识4之阻塞赋值 & 非阻塞赋值

  • 阻塞赋值语句串行块语句中的阻塞赋值语句按顺序执行,它不会阻塞其后并行块中语句的执行。阻塞赋值语句使用“=”作为赋值符。 例子 阻塞赋值语句 reg x, y, z; reg [15:0] reg_a, reg_b; integer count; // 所有行为语句必须放在 initial 或 always 块内部 initial begin x
  • 关键字:FPGAverilog HDL阻塞赋值非阻塞赋值

Verilog HDL基础之:赋值语句和块语句

  • 在Verilog HDL语言中,信号有两种赋值方式:非阻塞赋值方式和阻塞赋值方式。块语句通常用来将两条或多条语句组合在一起,使其在格式上看更像一条语句。块语句有两种:一种是begin_end语句,通常用来标识顺序执行的语句,用它来标识的块称为顺序块;另一种是fork_join语句,通常用来标识并行执行的语句。
  • 关键字:VerilogHDL华清远见赋值语句块语句阻塞赋值
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阻塞赋值介绍

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