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英特尔宣布成立全新独立运营的FPGA公司——Altera

今天，英特尔宣布成立全新独立运营的FPGA公司——Altera。在FPGA Vision线上研讨会期间，首席执行官Sandra Rivera和首席运营官Shannon Poulin进行了分享，展示其在超过550亿美元的市场中保持领先性的战略规划，强调将通过打造集成AI功能的FPGA等举措，进一步丰富公司的产品组合，同时亦表明将持续助力客户应对不断增加的挑战。会上，Altera也作为新公司的品牌正式对外公布。Altera首席执行官Sandra Rivera表示，“现阶段，客户正面临日益复杂的技术挑战，而我们
关键字：英特尔 FPGA Altera

PCB焊盘还有这么讲究

在PCB设计中，焊盘是一个非常重要的概念，PCB工程师对它一定不陌生。不过，虽然熟悉，很多工程师对焊盘的知识却是一知半解。今天，电路菌带大家来了解下焊盘的种类，以及在PCB设计中焊盘的设计标准。焊盘，表面贴装装配的基本构成单元，用来构成电路板的焊盘图案(land pattern)，即各种为特殊元件类型设计的焊盘组合。焊盘用于电气连接、器件固定或两者兼备的部分导电图形。PCB焊盘的种类一、常见焊盘1、方形焊盘——印制板上元器件大而少、且印制导线简单时多采用。在手工自制PCB时，采用这种焊盘易于实现。2、圆形
关键字：PCB 电路设计

PCB布线设计参考

PCB常见布线规则（1） PCB板上预划分数字、模拟、DAA信号布线区域。（2）数字、模拟元器件及相应走线尽量分开并放置于各自的布线区域内。（3）高速数字信号走线尽量短。（4）敏感模拟信号走线尽量短。（5）合理分配电源和地。（6） DGND、AGND、实地分开。（7）电源及临界信号走线使用宽线。（8）电源线与地线应尽可能呈放射状，以及信号线不能出现回环走线。（9）数字电路放置于并行总线/串行DTE接口附近，DAA电路放置于电话线接口附近。（10）小的分立器件走线须对称，间距比较密的SMT焊盘引线应从
关键字：PCB 电路设计

CPLD/FPGA 内部结构与原理

可编程逻辑器件（Programmable Logic Device，PLD）起源于20世纪70年代，是在专用集成电路（ASIC）的基础上发展起来的一种新型逻辑器件，是当今数字系统设计的主要硬件平台，其主要特点就是完全由用户通过软件进行配置和编程，从而完成某种特定的功能，且可以反复擦写。在修改和升级PLD时，不需额外地改变PCB电路板，只是在计算机上修改和更新程序，使硬件设计工作成为软件开发工作，缩短了系统设计的周期，提高了实现的灵活性并降低了成本，因此获得了广大硬件工程师的青睐，形成了巨大的PLD产业规模
关键字：FPGA CPLD

浅谈因电迁移引发的半导体失效

前言半导体产品老化是一个自然现象，在电子应用中，基于环境、自然等因素，半导体在经过一段时间连续工作之后，其功能会逐渐丧失，这被称为功能失效。半导体功能失效主要包括：腐蚀、载流子注入、电迁移等。其中，电迁移引发的失效机理最为突出。技术型授权代理商Excelpoint世健的工程师Wolfe Yu在此对这一现象进行了分析。 1、背景从20世纪初期第一个电子管诞生以来，电子产品与人类的联系越来越紧密，特别是进入21世纪以来，随着集成电路的飞速发展，人们对电子产品的需求也变得愈加丰富。随着电子
关键字：电迁移半导体失效世健 Microchip Flash FPGA

2024年FPGA将如何影响AI？

随着新一年的到来，科技界有一个话题似乎难以避开：人工智能。事实上，各家公司对于人工智能谈论得如此之多，没有热度才不正常！在半导体领域，大部分对于AI的关注都集中在GPU或专用AI加速器芯片（如NPU和TPU）上。但事实证明，有相当多的组件可以直接影响甚至运行AI工作负载。FPGA就是其中之一。对于那些了解FPGA灵活性和可编程性的人来说，这并不令人惊讶，但对许多其他人来说，这两者之间的联系可能并不明显。问题的关键在于通过软件让一些经典的AI开发工具（如卷积神经网络（CNN））针对FPGA支持的可定制电路设
关键字：FPGA AI 莱迪思

Verilog HDL基础知识9之代码规范示例

2.Verilog HDL 代码规范模板示例//******************************************************** // // Copyright(c)2016, ECBC // All rights reserved // // File name
关键字：FPGA verilog HDL 代码规范

Verilog HDL基础知识9之代码规范

1.RTL CODE 规范1.1标准的文件头在每一个版块的开头一定要使用统一的文件头，其中包括作者名，模块名，创建日期，概要，更改记录，版权等必要信息。统一使用以下的文件头：其中*为必需的项目//******************************************************** // // Copyright(c)2016, ECBC // All rights&nbs
关键字：FPGA verilog HDL 代码规范

详解CPLD/FPGA架构与原理

可编程逻辑器件（Programmable Logic Device，PLD）起源于20世纪70年代，是在专用集成电路（ASIC）的基础上发展起来的一种新型逻辑器件，是当今数字系统设计的主要硬件平台，其主要特点就是完全由用户通过软件进行配置和编程，从而完成某种特定的功能，且可以反复擦写。在修改和升级PLD时，不需额外地改变PCB电路板，只是在计算机上修改和更新程序，使硬件设计工作成为软件开发工作，缩短了系统设计的周期，提高了实现的灵活性并降低了成本，因此获得了广大硬件工程师的青睐，形成了巨大的PLD产业规模
关键字：CPLD FPGA 架构

Verilog HDL基础知识8之综合语句

可综合语句1.要保证Verilog HDL赋值语句的可综合性，在建模时应注意以下要点：2.不使用initial。3.不使用#10。4.不使用循环次数不确定的循环语句，如forever、while等。5.不使用用户自定义原语（UDP元件）。6.尽量使用同步方式设计电路。7.除非是关键路径的设计，一般不采用调用门级元件来描述设计的方法，建议采用行为语句来完成设计。8.用always过程块描述组合逻辑，应在敏感信号列表中列出所有的输入信号。9.所有的内部寄存器都应该能够被复位，在使用FPGA实现设计时，应尽量使
关键字：FPGA verilog HDL 综合语句

Microchip推出低成本PolarFire SoC Discovery工具包加速RISC-V和FPGA设计

嵌入式行业对基于RISC-V®的开源处理器架构的需求日益增长，但在商用芯片或硬件方面的选择仍然有限。为了填补这一空白并推动创新，Microchip Technology Inc.（微芯科技公司）宣布推出PolarFire® SoC Discovery工具包。通过为嵌入式处理和计算加速提供用户友好、功能丰富的开发工具包，Microchip可帮助各种水平的工程师采用新兴技术。新发布的开源开发工具包具有支持Linux®和实时应用的四核 RISC-V 应用级处理器、丰富的外设和95K低功耗高性能FPGA逻辑元件。
关键字：Microchip PolarFire 嵌入式系统工程师 RISC-V FPGA

Verilog HDL基础知识7之模块例化

Verilog使用模块（module）的概念来代表一个基本的功能块。一个模块可以是一个元件，也可以是低层次模块的组合。常用的设计方法是使用元件构建在设计中多个地方使用的功能块，以便进行代码重用。模块通过接口（输入和输出）被高层的模块调用，但隐藏了内部的实现细节。这样就使得设计者可以方便地对某个模块进行修改，而不影响设计的其他部分。在verilog中，模块声明由关键字module开始，关键字endmodule则必须出现在模块定义的结尾。每个模块必须具有一个模块名，由它唯一地标识这个模块。模块的端口列表则描述
关键字：FPGA verilog HDL 模块例化

Verilog HDL基础知识6之语法结构

虽然 Verilog 硬件描述语言有很完整的语法结构和系统，这些语法结构的应用给设计描述带来很多方便。但是 Verilog是描述硬件电路的，它是建立在硬件电路的基础上的。有些语法结构是不能与实际硬件电路对应起来的，比如 for 循环，它是不能映射成实际的硬件电路的，因此，Verilog 硬件描述语言分为可综合和不可综合语言。下面我们就来简单的介绍一下可综合与不可综合。(1) 所谓可综合，就是我们编写的Verilog代码能够被综合器转化为相应的电路结构。因此，我们常用可综合语句来描述数字硬件电路。(2) 所
关键字：FPGA verilog HDL 语法结构

英特尔FPGA Vision线上研讨会亮点抢先看

继宣布将可编程解决方案事业部 (PSG) 作为独立业务部门运营后，英特尔将于3月1日举行FPGA Vision线上研讨会。届时，首席执行官Sandra Rivera和首席运营官Shannon Poulin将分享有关全新企业品牌、公司愿景与战略，以及市场增长机会的更多信息。英特尔PSG团队诚邀您参加本次线上研讨会，深入了解独立运营的全新FPGA公司，持续增长的市场及客户需求，以及我们旨在助力行业创新加速的产品路线图。与此同时，线上研讨会还将重点介绍FPGA在AI领域的布局，即如何使AI在数据中心
关键字：英特尔 FPGA

Verilog HDL基础知识4之阻塞赋值 & 非阻塞赋值

阻塞赋值语句串行块语句中的阻塞赋值语句按顺序执行，它不会阻塞其后并行块中语句的执行。阻塞赋值语句使用“=”作为赋值符。例子阻塞赋值语句 reg x, y, z; reg [15:0] reg_a, reg_b; integer count; // 所有行为语句必须放在 initial 或 always 块内部 initial begin x
关键字：FPGA verilog HDL 阻塞赋值非阻塞赋值

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